メインコンテンツへスキップ
buildradar
Sign in

zachjs/sv2v

@zachjs

SystemVerilog から Verilog への変換

スター
751
フォーク
66
言語
Haskell
ライセンス
BSD-3-Clause
最終プッシュ
3 週間前
Haskellconversionverilogsystemverilogyosys

関連 Intel はまだありません

このリポジトリは radar が追跡するソースにまだ登場していません。コレクターはスケジュールで動いています——このリポジトリがカバーされたらまた見てください。