Saltar al contenido principal
buildradar
Iniciar sesión

verilog-to-routing/vtr-verilog-to-routing

@verilog-to-routing

Verilog to Routing: flujo CAD de código abierto para investigación en FPGA.

Estrellas
1265
Bifurcaciones
445
Lenguaje
C++
Licencia
NOASSERTION
Último push
hace 11 horas
C++routingsynthesiscadfpgaedaverilogplacementvprvtr

Aún no hay intel relacionado

Este repo no ha aparecido en ninguna de las fuentes que rastrea el radar. El recopilador funciona con un horario — vuelve cuando lo haya cubierto.