Saltar al contenido principal
buildradar
Sign in

zachjs/sv2v

@zachjs

Conversión de SystemVerilog a Verilog.

Estrellas
751
Bifurcaciones
66
Lenguaje
Haskell
Licencia
BSD-3-Clause
Último push
hace 3 semanas
Haskellconversionverilogsystemverilogyosys

Aún no hay intel relacionado

Este repo no ha aparecido en ninguna de las fuentes que rastrea el radar. El recopilador funciona con un horario — vuelve cuando lo haya cubierto.