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chipsalliance

Dépôts open source suivis de chipsalliance, triés par étoiles.

6 dépôts

#1
chisel ↗@chipsallianceScala
Chisel : Un langage de conception matérielle moderne.
★ 4 773+9Évolution des étoiles sur les 7 derniers jours
#2
rocket-chip ↗@chipsallianceScala
Générateur Rocket Chip
★ 3 855+3Évolution des étoiles sur les 7 derniers jours
#3
verible ↗@chipsallianceC++
Verible est une suite d'outils de développement SystemVerilog, comprenant un analyseur, un linter de style, un formateur et un serveur de langage.
★ 1 927+6Évolution des étoiles sur les 7 derniers jours
#4
riscv-dv ↗@chipsalliancePython
Générateur d'instructions aléatoires pour la vérification de processeurs RISC-V
★ 1 351+1Évolution des étoiles sur les 7 derniers jours
#5
Cores-VeeR-EH1 ↗@chipsallianceSystemVerilog
Noyau VeeR EH1
★ 966+1Évolution des étoiles sur les 7 derniers jours
#6
chisel-template ↗@chipsallianceShell
Un projet modèle pour démarrer de nouveaux travaux avec Chisel.
★ 708+1Évolution des étoiles sur les 7 derniers jours