Pular para o conteúdo principal
buildradar
Sign in

zachjs/sv2v

@zachjs

Conversão de SystemVerilog para Verilog

Estrelas
751
Bifurcações
66
Linguagem
Haskell
Licença
BSD-3-Clause
Último push
há 3 semanas
Haskellconversionverilogsystemverilogyosys

Ainda não há intel relacionado

Este repo ainda não apareceu em nenhuma das fontes que o radar rastreia. O coletor roda em um cronograma — volte quando ele cobrir este repo.