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Tópico · verilog

verilog

Repositórios de código aberto acompanhados marcados com verilog, ordenados por estrelas.

53 repositórios
  • kianRiscV@splinedrive

    SoC RISC-V XV6/Linux, marchID: 0x2b, 0x34

    1.114+1Variação de estrelas nos últimos 7 dias
  • veryl@veryl-lang

    Veryl: Uma linguagem de descrição de hardware moderna

    1.031+4Variação de estrelas nos últimos 7 dias
  • apio@FPGAwars

    Ecossistema de código aberto para placas FPGA abertas.

    1.006+1Variação de estrelas nos últimos 7 dias
  • scr1@syntacore

    O SCR1 é um núcleo de MCU RISC-V de código aberto de alta qualidade em Verilog

    1.001+2Variação de estrelas nos últimos 7 dias
  • FPGA-USB-Device@WangXuan95

    Um core de dispositivo USB 1.1 (full-speed) baseado em FPGA para implementar USB-serial, USB-camera, USB-audio, USB-hid, etc. Requer apenas 3 IOs comuns de FPGA em vez de chips adicionais.

    921+3Variação de estrelas nos últimos 7 dias
  • openwifi-hw@open-sdr

    Design de FPGA (chip) de banda base WiFi IEEE 802.11 open source: FPGA, hardware

    893+1Variação de estrelas nos últimos 7 dias
  • step_into_mips@lvyufeng

    Escrevendo uma CPU MIPS passo a passo

    882+3Variação de estrelas nos últimos 7 dias
  • nvc@nickg

    Compilador e simulador VHDL

    878+0Variação de estrelas nos últimos 7 dias
  • verilog2factorio@Redcrafter

    Este projeto compila Verilog (uma linguagem de descrição de hardware) em blueprints do Factorio.

    828+0Variação de estrelas nos últimos 7 dias
  • openpiton@PrincetonUniversity

    A Plataforma OpenPiton.

    819+8Variação de estrelas nos últimos 7 dias
  • edalize@olofk

    Uma biblioteca de abstração para interface com ferramentas EDA

    793+3Variação de estrelas nos últimos 7 dias
  • z80-open-silicon@rejunity

    Clone de silício open-source do Z80. O objetivo é se tornar um substituto open-source validado em silício e compatível com pinos para o Z80 clássico.

    792+4Variação de estrelas nos últimos 7 dias
  • projf-explore@projf

    O Project F dá vida a FPGAs com designs open-source empolgantes nos quais você pode construir em cima.

    789+1Variação de estrelas nos últimos 7 dias
  • sv2v@zachjs

    Conversão de SystemVerilog para Verilog

    751+2Variação de estrelas nos últimos 7 dias
  • vscode-terosHDL@TerosTechnology

    IDE para VHDL e Verilog/SV: visualizador de máquinas de estado, linter, documentação, snippets e mais!

    739-1Variação de estrelas nos últimos 7 dias
  • OpenROAD-flow-scripts@The-OpenROAD-Project

    Scripts do OpenROAD implementando um fluxo RTL-to-GDS. Documentação em https://openroad-flow-scripts.readthedocs.io/en/latest/

    730+8Variação de estrelas nos últimos 7 dias
  • OpenTimer@OpenTimer

    Uma ferramenta de análise de tempo de alto desempenho para sistemas VLSI.

    715+2Variação de estrelas nos últimos 7 dias
  • O último guia de PCILeech DMA CFW que você vai precisar. Patrocinado por DMAPolice.com

    631+5Variação de estrelas nos últimos 7 dias
  • Uma lista de ferramentas e frameworks de verificação de hardware gratuitos e de código aberto

    622+1Variação de estrelas nos últimos 7 dias
  • mor1kx@openrisc

    mor1kx - um núcleo IP de processador OpenRISC 1000

    590+3Variação de estrelas nos últimos 7 dias
  • svls@dalance

    Servidor de linguagem SystemVerilog

    585+2Variação de estrelas nos últimos 7 dias
  • ASIC-Design-Roadmap@abdelazeem201

    A jornada de projeto de um ASIC (circuito integrado de aplicação específica) é longa e envolve várias etapas principais – desde o conceito até a especificação e o tape-out. Embora o produto final seja geralmente muito pequeno (medido em nanômetros), essa longa jornada é interessante e repleta de desafios de engenharia.

    560+5Variação de estrelas nos últimos 7 dias
  • shrike@vicharak-in

    Low cost microcontroller + FPGA board for makers , hobbyist and student for endless possibility.

    510+4Variação de estrelas nos últimos 7 dias
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