跳到主要内容
buildradar
Sign in
主题 · fpga

fpga

标记 fpga 主题、收录中的开源项目,按星标数排序。

项目数
75
总星标数
126,649
平均星标数
1,689
占比
0.01%

常跟 fpga 一起出现在同一个项目上的主题。

近期新秀

近 90 天内创建、标记 fpga 主题的项目。

近 90 天内还没有新项目标记这个主题。

  • john@openwall

    John the Ripper jumbo - 进阶离线密码破解工具,支持数百种哈希和加密类型,可在多种操作系统、CPU、GPU,甚至部分 FPGA 上运行。

    13,584+20近 7 天星标变化
  • logisim-evolution@logisim-evolution

    数字逻辑设计工具与模拟器

    7,517+21近 7 天星标变化
  • Paddle-Lite@PaddlePaddle

    PaddlePaddle 高性能深度学习端侧推理引擎(移动和边缘)

    7,272+0近 7 天星标变化
  • openwifi@open-sdr

    开源 IEEE 802.11 WiFi 基带 FPGA(芯片)设计:驱动程序、软件

    4,779+3近 7 天星标变化
  • litex@enjoy-digital

    轻松构建你的硬件

    4,068+4近 7 天星标变化
  • VexRiscv@SpinalHDL

    FPGA 友好的 32 位 RISC‑V CPU 实作

    3,239+7近 7 天星标变化
  • cva6@openhwgroup

    CORE‑V CVA6 是一个高度可配置的 6 随段 RISC‑V 核心,适用于应用与嵌入式应用。应用类配置可启动 Linux。

    3,090+3近 7 天星标变化
  • darkriscv@darklife

    在一夜之间用 Verilog 从头实现的开源 RISC-V CPU 核心!

    2,602+1近 7 天星标变化
  • corundum@corundum

    基于开源 FPGA 的网卡与网内计算平台

    2,446+7近 7 天星标变化
  • neorv32@stnolting

    🖥️ 以跨平台 VHDL 编写的小型、可定制且可扩展的 MCU 级 32 位 RISC-V 软核 CPU 和类微控制器 SoC。

    2,249+4近 7 天星标变化
  • GPGPU 微处理器架构

    2,220+1近 7 天星标变化
  • glasgow@GlasgowEmbedded

    电子学的瑞士军刀。

    2,205+3近 7 天星标变化
  • hls4ml@fastmachinelearning

    使用 HLS 在 FPGA 上进行机器学习

    2,121+5近 7 天星标变化
  • amaranth@amaranth-lang

    基于 Python 的现代硬件描述语言与工具链

    2,078+4近 7 天星标变化
  • SpinalHDL@SpinalHDL

    基于 Scala 的 HDL

    2,032+1近 7 天星标变化
  • basic_verilog@pConst

    必备的 verilog systemverilog 模块

    2,017+2近 7 天星标变化
  • hdl@analogdevicesinc

    HDL 库与项目

    2,002+1近 7 天星标变化
  • icestudio@FPGAwars

    :snowflake: 开源 FPGA 开发板的可视化编辑器

    1,924+0近 7 天星标变化
  • e203_hbirdv2@riscv-mcu

    超低功耗 RISC-V 核心

    1,906+1近 7 天星标变化
  • serv@olofk

    SERV - 串行式 RISC-V CPU

    1,878+2近 7 天星标变化
  • openFPGALoader@trabucayre

    用于对 FPGA 进行编程的通用实用程序

    1,720+2近 7 天星标变化
  • axi@pulp-platform

    用于高性能片上通信的 AXI SystemVerilog 可综合 IP 模块与验证基础设施

    1,677+9近 7 天星标变化
  • clash-compiler@clash-lang

    Haskell 转 VHDL/Verilog/SystemVerilog 编译器

    1,609+1近 7 天星标变化
  • Vitis 深入教程。

    1,608+1近 7 天星标变化
  • zipcpu@ZipCPU

    一个小型、轻量级的 RISC CPU 软核

    1,579+2近 7 天星标变化
  • brevitas@Xilinx

    Brevitas:PyTorch 中的神经网络量化

    1,568+1近 7 天星标变化
  • fusesoc@olofk

    用于 FPGA/ASIC 开发的软件包管理器与构建抽象工具

    1,453+0近 7 天星标变化
  • platformio-vscode-ide@platformio

    PlatformIO IDE for VSCode:新一代的物联网(IoT)整合开发环境

    1,448+1近 7 天星标变化
  • Silice@sylefeb

    Silice 是一门易学且强大的硬件描述语言,它简化了通过并行和流水线设计硬件算法的过程。

    1,430+0近 7 天星标变化
  • wireguard-fpga@chili-chips-ba

    全速、线速的 Wireguard VPN 硬件实现,使用低成本的 Artix7 FPGA 与开源工具链。如果您追求安全与隐私,我们的代码库中没有任何隐私,大门永远敞开欢迎对后门进行审查,无论是 RTL、嵌入式、构建、bitstream 或是设计与交付套件的任何其他方面。请进!

    1,356+1近 7 天星标变化
← 返回主题列表